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Table 5.3. Memory System Peripherals
Peripherals
Address range
0x40010C00 – 0x4007FFFF
0x40010800 – 0x40010BFF
0x40010400 – 0x400107FF
0x40010000 – 0x400103FF
0x4000E400 – 0x4000FFFF
0x4000E000 – 0x4000E3FF
0x4000CC00 – 0x4000DFFF
0x4000C800 – 0x4000CBFF
0x4000C400 – 0x4000C7FF
0x4000C000 – 0x4000C3FF
0x4000A400 – 0x4000BFFF
0x4000A000 – 0x4000A3FF
0x40008400 – 0x40009FFF
0x40008000 – 0x400083FF
0x40007000 – 0x40007FFF
0x40006000 – 0x40006FFF
0x40004400 – 0x40005FFF
0x40004000 – 0x400043FF
0x40002400 – 0x40003FFF
0x40002000 – 0x400023FF
0x40001800 – 0x40001FFF
0x40001400 – 0x400017FF
0x40001000 – 0x400013FF
0x40000400 – 0x40000FFF
0x40000000 - 0x400003FF
Peripheral
Reserved
TIMER2
TIMER1
TIMER0
Reserved
UART0
Reserved
USART2
USART1
USART0
Reserved
I2C0
Reserved
EBI
Reserved
GPIO
Reserved
DAC0
Reserved
ADC0
Reserved
ACMP1
ACMP0
Reserved
VCMP
5.2.3 Bus Matrix
The Bus Matrix connects the memory segments to the bus masters:
? Code: CPU instruction or data fetches from the code space
? System: CPU read and write to the SRAM, EBI and peripherals
? DMA: Access to code space, SRAM, EBI and peripherals
5.2.3.1 Arbitration
The Bus Matrix uses a round-robin arbitration algorithm which enables high throughput and low latency
while starvation of simultaneous accesses to the same bus slave are eliminated. Round-robin does not
assign a fixed priority to each bus master. The arbiter does not insert any bus wait-states.
2011-04-12 - d0001_Rev1.10
17
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